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山東省濟南市高新區
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| ?應屆畢業生(sheng)? | ?本科? |
?年齡不限? | ?招3~5人? | ?實(shi)習(xi)
崗位職責
1.FPGA IP 軟核的設計與研發；
2.基于HDL的數字集成電路設計與仿真，驗證與測試；
3.根據項目要求(qiu)，建立(li)IP驗證(zheng)環境及測試用例的開發；
崗位要求
1.微電子、電子信息等相關專業大三大四或研究生在讀；
2.熟悉掌握FPGA/ASIC設計原理；
3.熟悉掌握Verilog HDL語言；
4.熟(shu)悉IC設計流(liu)程及EDA常用仿真(zhen)工(gong)具;
晉升機制
助理工(gong)程師工程師(shi)資深工(gong)程師總工(gong)程師
工作地址
山東省濟(ji)南(nan)市高新區齊魯軟件園E座(zuo)516
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HR信息
于杰
3日內活躍
HR
|
HR
| 自投遞起3個工作日內答復
聊天意(yi)愿
暫無(wu)
活躍時段 潛水(shui)
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邏輯驗證實習生 11-11
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軟件研發(fa)工程師 11-11
8-15K 濟南市-高新區 | 年(nian)齡(ling)不限 | 本(ben)科
模擬(ni)IC設計工(gong)程(cheng)師 11-11
8-15K 濟(ji)南市-高新(xin)區 | 年齡不限 | 本科
IC設計驗證工程師 11-11
8-15K 濟南(nan)市(shi)-高新區 | 年齡(ling)不限 | 本科
硬件工程師(shi) 11-11
8-15K 濟南市(shi)-高新區 | 年(nian)齡不限 | 本科
電(dian)子技術/半導體(ti)/集成電(dian)路
私營企業
50~100人
山東省濟(ji)南(nan)市高(gao)新(xin)區齊魯軟件園(yuan)E座516
感興趣的職位
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