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山東省濟南市高新區
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| ?應屆畢業(ye)生? | ?本科? |
?年(nian)齡(ling)不限? | ?招3~5人(ren)? | ?實習(xi)
崗位職責
1.FPGA IP 軟核的設計與研發；
2.基于HDL的數字集成電路設計與仿真，驗證與測試；
3.根(gen)據項目要求，建立IP驗證環境及測(ce)試(shi)用例的開發；
崗位要求
1.微電子、電子信息等相關專業大三大四或研究生在讀；
2.熟悉掌握FPGA/ASIC設計原理；
3.熟悉掌握Verilog HDL語言；
4.熟悉(xi)IC設計(ji)流(liu)程及EDA常用仿真(zhen)工具;
晉升機制
助理工程師工(gong)程師資深工(gong)程(cheng)師(shi)總工程師
工作地址
山東省濟南市高新區齊魯軟件園E座516
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HR信息
于杰
3日內活躍
HR
|
HR
| 自投遞起3個工作日內答復
聊(liao)天(tian)意愿
暫無(wu)
活躍(yue)時段 潛水(shui)
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8-15K 濟南市(shi)-高新區 | 年齡不限 | 本(ben)科
電子技術/半導(dao)體/集成電路(lu)
私營企業
50~100人
山(shan)東省濟(ji)南市高新區齊魯軟件(jian)園E座516
感興趣的職位
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