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山東省濟南市高新區
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| ?應屆(jie)畢(bi)業生? | ?本科? |
?年齡不(bu)限? | ?招3~5人? | ?實習
崗位職責
1.FPGA IP 軟核的設計與研發；
2.基于HDL的數字集成電路設計與仿真，驗證與測試；
3.根(gen)據項目要求(qiu)，建立(li)IP驗證環境及測試用例的開發；
崗位要求
1.微電子、電子信息等相關專業大三大四或研究生在讀；
2.熟悉掌握FPGA/ASIC設計原理；
3.熟悉掌握Verilog HDL語言；
4.熟悉(xi)IC設(she)計(ji)流程及(ji)EDA常用仿真工具;
晉升機制
助理工程師工程師資(zi)深工程師總工程師
工作地址
山東省濟南市高新區齊魯軟件園E座516
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HR信息
于杰
3日內活躍
HR
|
HR
| 自投遞起3個工作日內答復
聊天意愿
暫無
活躍時段 潛水
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電子技(ji)術/半導體/集(ji)成電路
私營企(qi)業
50~100人
山東省(sheng)濟(ji)南(nan)市高新區齊(qi)魯軟件園(yuan)E座516
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