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山東省濟寧市高新區
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| ?3-5年(nian)? | ?本(ben)科? |
?25歲-40歲? | ?招3~5人? | ?全職
崗位職責
1、負責視頻圖像算法,圖像接口,網絡通信在FPGA上實現,負責FPGA詳細設計、測試計劃等相關開發測試文檔編寫;
2、Verilog/VHDL代碼編寫、仿真、時序約束/分析
3、承擔(dan)新產品項目開發。
崗位要求
1、計算機或相關專業本科學歷以上;
2、3年以上FPGA工作經驗;
3、有PCIE、以太網、USB3.0、RS484、CAN等接口調試經驗,熟悉常用的TCP/IP/CANOPEN/MODBUS等通信協議;
4、有感光芯片圖像采集以及圖像處理經驗,熟悉視頻信號處理算法FPGA實現,如視頻壓縮編解碼算法、視頻縮放算法等優先;
5、有Altera/Xilinx系列(lie)FPGA芯片(pian)開(kai)發經驗,熟(shu)悉QuartusII/ISE/Modelsim等EDA軟件(jian),熟(shu)練掌握Verilog/VHDL語言(yan);
晉升機制
軟件(jian)開發工(gong)程師高級軟件(jian)開發工程(cheng)師項目經理項目總監CTO系統架(jia)構師(shi)資深(shen)架構師
工作地址
山(shan)東省濟寧市高新區(qu)第十一(yi)工業園
展開(kai)地圖(tu)
HR信息
李經理
3日內活躍
人力資源部
自投遞起4個工作日內答復聊天(tian)意愿
暫無
活躍(yue)時段(duan) 冒泡 下午7-8點(dian) 最活躍
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