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山東省濟寧市高新區
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| ?1-2年(nian)? | ?本科(ke)? |
?22歲-38歲? | ?招3~5人? | ?全職
崗位職責
1、精通硬件描述語言，能夠熟練進行FPGA編程；
2、具有通信設備、視頻圖像處理等算法的FPGA設計實踐經驗；
3、有良好的硬件基礎知識，能獨立完成設計開發任務；
4、負責(ze)有線(xian)通信產品(pin)中FPGA代碼的編寫及(ji)相(xiang)關技(ji)術文(wen)檔(dang)編寫。
崗位要求
1、本科以上學歷，通信工程、電子信息、計算機技術及相關專業；
2、能熟練閱讀英文資料；
3、精通VHDL或Verilog語言；
4、熟悉FPGA的設計和開發流程，具有獨立的FPGA編碼、仿真、調試能力；
5、掌握Xilinx或Altera器件的結構和特點；
6、熟練使用ISE、QuartusII、ModelSim、Matlab等開發工具；
7、熟悉有線通信產品（SDH/MSTP、EPON/GPON、OTN、PTN、WDM等）者優先；
8、具有(you)較(jiao)強的溝通和協調能(neng)力(li)，做事(shi)認真、踏(ta)實(shi)、細致，有(you)深厚(hou)的團隊協作能(neng)力(li)。
工作地址
山東省濟寧市高新區崇文(wen)大道(dao)431號(hao)
展(zhan)開地圖
HR信息
褚老師
3日內活躍
人力資源部
自投遞起3個工作日內答復
聊天意愿
暫無
活(huo)躍時段 潛水(shui)
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501~1000人
山(shan)東省濟寧市高(gao)新(xin)區濟寧市高(gao)新(xin)區崇(chong)文(wen)大道431號。
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